\n
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HTIF2 : HTIF2
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DIR : DIR
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CIRC : CIRC
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PINC : PINC
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MINC : MINC
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PSIZE : PSIZE
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MSIZE : MSIZE
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PL : PL
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MEM2MEM : MEM2MEM
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channel x number of data to transfer register
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DMA channel x memory address register
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GIF2 : GIF2
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TCIF2 : TCIF2
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HTIF2 : HTIF2
bits : 6 - 6 (1 bit)
TEIF2 : TEIF2
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GIF3 : GIF3
bits : 8 - 8 (1 bit)
TCIF3 : TCIF3
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HTIF3 : HTIF3
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GIF4 : GIF4
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TEIF4 : TEIF4
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GIF5 : GIF5
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TCIF5 : TCIF5
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HTIF5 : HTIF5
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TEIF5 : TEIF5
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GIF6 : GIF6
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TCIF6 : TCIF6
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GIF7 : GIF7
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TEIF7 : TEIF7
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GIF8 : GIF8
bits : 28 - 28 (1 bit)
TCIF8 : TCIF8
bits : 29 - 29 (1 bit)
HTIF8 : HTIF8
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TEIF8 : TEIF8
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PSIZE : PSIZE
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PL : PL
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DMA channel x memory address register
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HTIE : HTIE
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CIRC : CIRC
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PSIZE : PSIZE
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PL : PL
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PSIZE : PSIZE
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DMA channel 1 configuration register
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PSIZE : PSIZE
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DMA channel x memory address register
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channel x number of data to transfer register
address_offset : 0xC Bytes (0x0)
size : 32 bit
access : read-write
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reset_Mask : 0x0
NDT : Number of data items to transfer
bits : 0 - 15 (16 bit)
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